[align=left]在自由电子的 Double V5 SOC 验证平台上，承载了两颗 Xilinx 公司的 Virtex5 LX330 FPGA 和丰富的功能电路，用户能以 400MHz 左右的频率，利用大约 660 万等效 ASIC 门的逻辑资源和最大 8GB DDR2 内存，对用户的 ASIC 设计进行全方位的实时验证。这一全新的原型验证板还提供了和 PC 机相连的 USB 接口，通过配套软件，方便用户通过此接口直接下载 FPGA bit 文件，配置可编程时钟，并对板上硬件进行自检。特别在配置高性能接插件的同时，通过精心优化的专业电路设计，使得多块Double V5 SOC 验证平台还能够堆叠以满足超高性能科学计算、超大规模存储器海量数据交换需求的客户，组成包含5280万等效门逻辑资源、64GB DDR2存储空间、3072个500MHz DSP运算单元的超强原型验证平台。[/align]

[align=left]特征[/align][align=left]1. 容量：[/align][align=left]l 双[font=Calibri]Virtex-5 [/font]XC5VLX330支持[font=ArialMT]660[/font][font=宋体]万[/font][font=ArialMT]ASIC[/font][font=宋体]逻辑门[/font][/align][align=left]l 双Virtex-5 XC5VLX330 合计[font=ArialMT]20Mbits [/font][font=宋体]片内[/font][font=ArialMT]RAM[/font][font=宋体]容量[/font][/align][align=left]2. 性能： [/align][align=left]l FPGA[font=宋体]内部工作时钟最高[/font][font=Arial]500M Hz[/font][/align][align=left]l FPGA2FPGA [font=宋体]差分数据时钟最高[/font][font=Arial]400M Hz[/font][/align][align=left]3. 高级时钟管理：[/align][align=left]l 两个板上有源晶振插座[/align][align=left]l 三对[font=Calibri]SMA[/font][font=宋体]时钟输入[/font][/align][align=left]l 三个[font=Calibri]1M~200M[/font][font=宋体]板上可编程时钟源[/font][/align][align=left]l 12 feedback clocks [/align][align=left]4. 240[font=宋体]专用扩展[/font][font=Calibri]IO[/font][font=宋体]：[/font][/align][align=left]l 支持差分[font=Calibri]LVDS[/font][/align][align=left]l 每个[font=Calibri]FPGA [/font]120[font=宋体]个专用扩展[/font][font=Arial]IO[/font][/align][align=left]5. 600[font=宋体]互联[/font][font=Calibri]IO[/font][font=宋体]：[/font][/align][align=left]l 单端或差分连接[/align][align=left]l 能使用共享[font=Calibri]IO[/font][font=宋体]扩展[/font][/align][align=left]l 支持多模块堆叠[/align][align=left]6. IO[font=宋体]电压可编程：[/font][/align][align=left]每一个专用的扩展[font=Calibri]IO[/font][font=宋体]可选[/font][font=Calibri]4[/font][font=宋体]个不同的[/font][font=Calibri]IO[/font][font=宋体]电源电压（[/font][font=Calibri]1.2V,1.8V,2.5V,3.3V[/font][font=宋体]）[/font][/align][align=left]7. 单路[font=Calibri]12V[/font][font=宋体]电源输入：[/font][/align][align=left]8. FPGA[font=宋体]配置方式：[/font][/align][align=left]使用[font=Times New Roman]Xilinx[/font][font=宋体]下载电缆[/font][font=Times New Roman]JTAG[/font][font=宋体]配置[/font][/align]

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